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VK1024B6×4 LCD控制驱动电路
VK1024B
6×4 LCD控制驱动电路
PAGE
PAGE 10
概述
VK1024B 是一个6×4的LCD驱动器,可软体程式控制使其适用于多样化的LCD应用线路,仅用到3 至4条信号线便可控制LCD驱动器,除此之外也可介由指令使其進入省电模式
功能特点
□ 工作电压:2.4~5.2V
片内 256kHz 的 RC 振荡电路
外接 32.768kHz 或 256kHz 的晶振输入
□ 1/2 或 1/3 的偏置,1/2、1/3 或 1/4 的占空比
内部时钟频率
Power down 命令减少电源损耗
内部时钟和 WDT 看门狗电路
时钟和 WDT 的溢出输出
有 8 种时钟/WDT 可供选择
6×4 的 LCD 驱 动
6×4 位的显示 RAM
3 端串行接口
内部 LCD 驱动频率
软件设置
□ 陈锐鸿:188?2466?2436
□ Q号:361?888?5898
数据模式和命令模式指令
R/W 地址自动累加
三种数据访问模式
VLCD 端子是用来调节 LCD 电压的
封装形式:SOP16
管脚排列图
CSB WRB DATA VSS VLCD VDD COMO COM1
SEG19 SEG20 SEG21
1615
16
15
14
13
12
11
10
9
1
2
3
4
5
6
7
8
VK1024B(SOP16)
腳位描述
Pad No.
Pad Name
I/O
function
1
CSB
I
晶片“致能”输入,内建 pull high 电阻,当 CS 为选辑 1 时,
资料及指令皆无法接收,当 CS 为选辑时,资料及指令始能接收
2
WRB
I
资料“写入”输入,内建 pull high 电阻。写入显示记忆体内的
资料在 WRB 正缘时会被输写入
3
DATA
I/O
连续的讯号输入输出脚位
4
VSS
-
负电源
5
VLCD
I
LCD 电源
6
VDD
-
正电源
7-10
COM0-COM3
O
LCD common 输出
11-16
SEG19--SEG24
O
LCD segment 输出
IRQ看门狗时序和时序基准发生器频率发生器VLCDSEG31
IRQ
看门狗时序和时序基准发生器
频率发生器
VLCD
SEG31
COM3
SEG0
LCD驱动/发射电路
COM0
控制和时序电路
显示RAM
BZ
BZ
BZ
VDD
VSS
DATA
WR
RD
OSCI
CS
OSCO
功能说明
显示存储—RAM 结构
静态显示存储器(RAM)结构为 6 ×4 位,贮存所显示的数据。RAM 的内容直接映射成 L CD 驱动器的内容。通过读,写和更改读、写的命令把数据存储到 R AM 中。RAM 中的内容映射至 L CD 的过程如下表所示:
COM3 COM2 COM1 COM0
SEG0
0
地址 6 位
(A5,A4┈A0)
SEG1
1
SEG2
2
SEG3
3
┊ ┊
SEG31
31
D3
D2
D1
D0
Data\Addr
系统振荡器
VK1024B 的时钟是用来产生时序基准/WDT 的时钟频率、LCD 驱动时钟和蜂鸣频率的。时钟来源于
256kHz 的 R C 振荡器,32.768kHz 的晶振或外接的由S /W 设置的外部 2 56kHz 的时钟。系统振荡的设置如下图所示。当执行完S YS DIS 命令后,系统时钟停止并且L CD 偏置发生器也将停止工作。此命令只适用于片内 R C 振荡或是晶振的时候。一旦系统时钟停止,则 L CD 显示变暗,时序基准/WDT 也将失去功能。
LCD OFF 这条命令是用来关闭 L CD 偏置发生器的。LCD OFF 命令使 L CD 偏置发生器关闭后,执行SYS DIS 命令减少电源损耗,相当于 P ower down 命令一样。但如果外接系统时钟的话, SYS DIS 命令既不能关闭振荡也不能进入 P ower down 模式。晶振可以在 O SI 端口外接一个32kHz 的频率。在这种情况下, 系统将无法进入 P ower down 模式,这就类似于外接一个 2 56kHz 的时钟。在系统上电工作
时,VK1024B 就处于 S YS DIS 状态。
RC振荡
RC振荡256kHz
1/8
System Clock
外部时钟
256kHz
晶振
32.768kHz
系统振荡设置
OSCI OSCO
时钟和看门狗时序(WDT)
时序基准发生器是由一个产生准确时序的 8 级递增计数器组成的。WDT 则是由一个 8 级时基发生器
和一个 2 级递增计数器组成,可以使主控制器或子系统在非正常情况下(未知的或不希望发生的跳转、执行错误等)停止工作。WDT 暂停,将设置一个 WDT 暂停标志。
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